【ISSUE】【Mac】macでVerilogHDLを動かす
2024年12月23日 17:28
ちょうど学校の授業でハードウェア記述言語なるものを習う上で演習を行うらしい。その時VerilogHDLで記述したものをコンパイルするらしいが、sublimeTextでコンパイルできないものかと思って調べたらできたので、メモする。
インストール済みパッケージ一覧
・SublimeLinter-contrib-iverilog
・SystemVerilog
・Verilog Automatic
・Verilog
・VHDL
とりあえずVerilog系、あるだけ入れてみた。Syntaxハイライトとかあるし、自動補完系もあるから、入れた方が楽だと思う。
$ brew install icarus-verilog でインストールすることが可能。関連パッケージも自動インストされる
上記のパッケージをインストールすれば、Verilog系のSyntaxは使えるようになっているが、Sublime上でiverilogを用いてコンパイルすることができない。なので、自分でsublime-buildを作る必要があるようです。SublimeのTools > Build System > New Build System
を選択。そして以下をそのまま貼り付けて、保存。保存名はなんでもいいけど、拡張子だけは変えないように。
・2017/07/18 追記
brewでインストールした際、インストール先は/usr/local/bin/
であり(which iverilog
などで確認可能)、pathが通っていないのでコンパイル・実行できないようでした。El Capitan以降のMacOSではSIPにより/usr/bin/
や/bin
などのディレクトリにはroot権限でも変更ができないようになりました。なので、インストールしたiverilog
をフルパスで読み込むことで実行できるようにします。
Tools > Build System > iverilog(保存名によって異なる)
を選択すれば、Sublime上でコンパイル・実行することができる。command + b
でコンパイルできる。実行したいときはshift + command + b
でRun
を選択すればできる。
以下にサンプル(HA)を書く。コピペして、コンパイル・実行
これの実行結果としていかが表示されれば終わりです。(人によって表示形式や内容は変わっているかもしれません)
Verilogを使うことでかなり簡単に回路シミュレーションをできるので、マスターできるようになりたいですね
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